Precios Iniciar sesión Registrarse

Categorías: Todo - instrucciones - puertos - datos - entidad

por Claudia Lopez hace 9 años

1762

Estructura de un programa en VHDL

Los programas escritos en VHDL tienen una estructura específica que incluye varias secciones importantes. En primer lugar, se deben declarar las bibliotecas necesarias, entre las cuales destaca la principal proporcionada por la IEEE.

CAD Y CAM

por Tomas Aranda

Plataformas Tecnológicas para la Formación en el SENA

por Daniela Castano Sanchez

modelo entidad relación

por Danny Korbold

Métodos, técnicas e instrumentos de recolección de datos.

por DENNIS ASENCIO

Estructura de un programa en VHDL

Los programas escritos en VHDL tienen una estructura específica que incluye varias secciones importantes. En primer lugar, se deben declarar las bibliotecas necesarias, entre las cuales destaca la principal proporcionada por la IEEE.

CAD Y CAM

Plataformas Tecnológicas para la Formación en el SENA

modelo entidad relación

Métodos, técnicas e instrumentos de recolección de datos.

Estructura de un programa en VHDL

Topic principal

Instrucciones secuenciales: IF-THEN-ELSE, IF-THEN-ELSIF-THEN-ELSE, CASE-WHEN, FOOR LOOP, FUNCIONES BOOLEANAS

Instrucciones concurrentes: WHEN-ELSE, WITH-SELECT, FOOR GENERATE, FUNCIONES BOOLEANAS

Tipos de datos usados por SIGNAL:BIT, BIT_VECTOR, STD_LOGIC, STD_LOGIC_VECTOR

Instrucciones: ARCHITECTURE, OF, IS, BEGIN, PROCESS, END, SIGNAL

ENTIDAD

La entidad pueden etiquetarse con cualquier nombre, siguiendo las reglas básicas que se usan para etiquetar un archivo común

Los puertos pueden etiquetarse con cualquier nombre, siguiendo las reglas básicas que se usan para etiquetar un archivo común

Tipos de datos: BIT, BIT_VECTOR, STD_LOGIC, STD_LOGIC_VECTOR

Instrucciones:ENTYTI,PORT, IS, END, OUT, IN, INOUT

LIBRERIAS

Librerias estadarizadas por la IEEE

Libreria principal: IEEE:STD_LOGIC_1164.ALL

Instrucciones: USE, LIBRARY

Mindomo

Más información

Preguntas Frecuentes

Estructura de un programa en VHDL

Los programas escritos en VHDL tienen una estructura específica que incluye varias secciones importantes. En primer lugar, se deben declarar las bibliotecas necesarias, entre las cuales destaca la principal proporcionada por la IEEE.

CAD Y CAM

Plataformas Tecnológicas para la Formación en el SENA

modelo entidad relación

Métodos, técnicas e instrumentos de recolección de datos.

Estructura de un programa en VHDL

Topic principal

Instrucciones secuenciales: IF-THEN-ELSE, IF-THEN-ELSIF-THEN-ELSE, CASE-WHEN, FOOR LOOP, FUNCIONES BOOLEANAS

Instrucciones concurrentes: WHEN-ELSE, WITH-SELECT, FOOR GENERATE, FUNCIONES BOOLEANAS

Tipos de datos usados por SIGNAL:BIT, BIT_VECTOR, STD_LOGIC, STD_LOGIC_VECTOR

Instrucciones: ARCHITECTURE, OF, IS, BEGIN, PROCESS, END, SIGNAL

ENTIDAD

La entidad pueden etiquetarse con cualquier nombre, siguiendo las reglas básicas que se usan para etiquetar un archivo común

Los puertos pueden etiquetarse con cualquier nombre, siguiendo las reglas básicas que se usan para etiquetar un archivo común

Tipos de datos: BIT, BIT_VECTOR, STD_LOGIC, STD_LOGIC_VECTOR

Instrucciones:ENTYTI,PORT, IS, END, OUT, IN, INOUT

LIBRERIAS

Librerias estadarizadas por la IEEE

Libreria principal: IEEE:STD_LOGIC_1164.ALL

Instrucciones: USE, LIBRARY

Difunde Mindomo

Mindomo

Más información

Preguntas Frecuentes